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共5条
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关键词:
CPU
AC
J
L
S
寄存器
累加寄存器
数据
数据通路
J
寄存器
L
累加寄存器
S
数据
数据通路
隶属试卷
题号
题干
难度系数/错误率
2020年下半年
嵌入式系统设计..
上午试卷
综合知识
第1题
选择题
在
CPU
和主存之间设置高速缓存(Cache)的目的是解决(1)的问题。
45%
2019年下半年
嵌入式系统设计..
上午试卷
综合知识
第14题
选择题
在
CPU
的内外常设置多级高速缓存(Cache),其主要目的是(14)。
46%
2015年下半年
嵌入式系统设计..
上午试卷
综合知识
第36题
选择题
在主存储器和
CPU
之间增加Cache的目的是(36)。
27%
2014年下半年
嵌入式系统设计..
上午试卷
综合知识
第6题
选择题
在
CPU
和主存之间设置“Cache”的作用是为了解决(6)的问题。
39%
2010年下半年
嵌入式系统设计..
上午试卷
综合知识
第31题
选择题
下图为
CPU
结构,其中有一个累加寄存器
AC
、一个状态寄存器和其他4个寄存器,各个部分之间的连线表示数据通路,箭头表示信息传送方向,其中a,b,c,d4个寄存器依次是(31)。
75%
示例说明:
选择
案例
论文
共5条
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